一种低功耗数字集成电路自检电路设计方法

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本文提出了一种专用芯片自检集成电路设计方法,包括低功耗LDO、内部振荡器、自检激励ROM、时钟PLL等,通过相当于一个普通芯片的IO的驱动电流大小的上电小电流驱动,可完成整个专用芯片静态自检,实现专用芯片的静态快速低功耗自检。 This paper presents a dedicated chip self-test integrated circuit design methods, including low-power LDO, internal oscillator, self-test incentive ROM, clock PLL, etc., through the equivalent of a common chip IO drive current size of the small current Driven to complete the entire ASIC static self-test, to achieve a dedicated chip static fast low-power self-test.
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