数字集成电路故障测试策略和技术的研究进展

来源 :电路与系统学报 | 被引量 : 0次 | 上传用户：linan9348

【摘要】

：

IC制造工艺的发展,持续增加着VLSI电路的集成密度,亦日益加大了电路故障测试的复杂性和困难度.作者在承担相应研究课题的基础上,综述了常规通用测试方法和技术,并分析了其局

【作者】

：

于云华石寅

【机构】

：

中国科学院,中国科学院

【出处】

：

电路与系统学报

【发表日期】

：

2004年3期

【关键词】

：

测试图形可测性设计内建自测试层次化测试

【基金项目】

：

国家自然科学专项基金资助项目(90207008)

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IC制造工艺的发展,持续增加着VLSI电路的集成密度,亦日益加大了电路故障测试的复杂性和困难度.作者在承担相应研究课题的基础上,综述了常规通用测试方法和技术,并分析了其局限性.详细叙述了边界扫描测试(BST)标准、可测性设计(DFT)思想和内建自测试(BIST)策略.针对片上系统(SoC)和深亚微米(VDSM)技术给故障测试带来的新挑战,本文进行了初步的论述和探讨.

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