【摘 要】
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为了节约资源，提高浮点加法运算的灵活性，提出一种支持一个双精度浮点加法和两个并行的单精度浮点加法的可重构加法器结构。该加法器结构遵循IEEE754标准，可以实现在双精度浮点
【基金项目】
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基金项目：专用集成电路与系统国家重点实验室开放课题基金项目（10KF014）
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为了节约资源，提高浮点加法运算的灵活性，提出一种支持一个双精度浮点加法和两个并行的单精度浮点加法的可重构加法器结构。该加法器结构遵循IEEE754标准，可以实现在双精度浮点加法和单精度浮点加法之间的功能切换，实现资源重用。通过大量的测试验证，该结构功能完全正确。通过资源共用，可以避免资源闲置，综合结果显示该设计在比双精度浮点加法器多用23．5％面积的前提下，可以并行实现两个单精度浮点加法，比实现相同功能的一个双精度浮点加法器和两个单精度浮点加法器共节省40％左右的面积。
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