【摘 要】
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本设计是将现场可编程逻辑器件FPGA与DDS技术相结合,以Xilinx的FPGA Basys3开发板为平台,Vivado集成开发软件为环境,利用Verilog HDL语言设计出的组合波形发生器。将各波形的
【机 构】
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扬州大学信息工程学院,江苏扬州,225000
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本设计是将现场可编程逻辑器件FPGA与DDS技术相结合,以Xilinx的FPGA Basys3开发板为平台,Vivado集成开发软件为环境,利用Verilog HDL语言设计出的组合波形发生器。将各波形的幅值转化为相位并将其数字化后的数据存储在ROM内,按照设定频率,以相应频率控制字Fre_control为步进,对相位进行累加,将累加相位值作为地址,通过该地址读取存放在存储器内的波形数据,经数模转换等外围电路得到所需波形。
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