【摘 要】
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提出了一种新型技术来降低动态比较器的功耗。预放大器的输出直接与锁存节点连接。在没有明显增大锁存节点负载电容的基础上,在隐藏的静态电流通路上设计2个开关晶体管来避免
【机 构】
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中国科学院微电子研究所健康电子研发中心; 中国科学院微电子研究所新一代通信射频芯片技术北京市重点实验室; 中国科学院大学未来技术学院;
【基金项目】
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国家自然科学基金资助项目(61574165)
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提出了一种新型技术来降低动态比较器的功耗。预放大器的输出直接与锁存节点连接。在没有明显增大锁存节点负载电容的基础上,在隐藏的静态电流通路上设计2个开关晶体管来避免静态功耗,实现了低功耗。基于TSMC 0.18μm CMOS工艺,对提出的比较器进行仿真,并与其他三种比较器进行对比。仿真结果表明,在1.8V供电电压、频率为100 MHz、共模电压为0.9V的条件下,该比较器的功耗为26.13μW,相比传统双尾动态比较器,功耗降低了49%。延时为219ps,失调电压为6.3mV。该比较器适用于低功耗设计领域。
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