改进的TurbO码算法的FPGA实现

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【摘要】

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本文提出一种使用FPGA实现改进的Turbo码算法的方法.在选用改进的最优周期交织序列的交织器和SISO(软输入软输出)译码器的Max-Log-MAP译码算法的硬件实现过程中,采用“自上而

【作者】

：

赵雅兴张宁

【机构】

：

天津大学电子信息工程学院,天津,300072

【出处】

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信号处理

【发表日期】

：

2002年3期

【关键词】

：

Turbo码迭代系统卷积码最优周期交织序列交织器软输入软输出译码器 Max-Log-MAP算法现场/可编程逻辑阵列

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本文提出一种使用FPGA实现改进的Turbo码算法的方法.在选用改进的最优周期交织序列的交织器和SISO(软输入软输出)译码器的Max-Log-MAP译码算法的硬件实现过程中,采用“自上而下”和“自下而上”相结合的设计方法.在采用并行算法的同时巧妙地改变前向矢量的计算顺序,减少了占用韵硬件资源.整个设计在MAX+PLUSH软件环境下仿真的结果表明,本设计实现的改进的Turbo码编码/译码器具有良好的误码性能和较高的实用价值.rn

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