【摘 要】
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文章基于Step-Max 10现场可编程门阵列(FPGA)开发板,并利用等波纹法实现有限冲激响应(FIR)数字滤波器的硬件方案,对信号进行滤波处理。介绍了FIR滤波器的数学原理,并讨论了在
【基金项目】
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南京工业大学浦江学院2019年校级教育教学改革研究项目(2019JG009Z)
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文章基于Step-Max 10现场可编程门阵列(FPGA)开发板,并利用等波纹法实现有限冲激响应(FIR)数字滤波器的硬件方案,对信号进行滤波处理。介绍了FIR滤波器的数学原理,并讨论了在Step-Max 10 FPGA中实现并行结构FIR滤波器的方法。利用FPGA自带的IP核来设计FIR滤波器,并通过Verilog HDL语言来设计完成。在烧写之前通过ModelSim进行仿真,结果表明,电路工作正确可靠,能够达到滤波要求。
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