超前滞后型数字锁相环LL-DPLL在FPGA/CPLD中的实现

来源 :湖北大学学报(自然科学版) | 被引量 : 0次 | 上传用户:zengguiyeah3
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研究超前滞后型数字锁相环的系统原理.讨论了数字信号在3个功能模块超前滞后的原理,给出了它们在FPGA/CPLD中实现的方式,为需要全数字锁相环控制的设备提供了一种可行的电路设计方案.
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