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文章讨论了基本的线形阵列加法器和基于水平压缩矩阵的并行阵列加法器,在此基础上提出了一种改进的阵列乘法器结构,通过生成多位的部分积,大大减少进位传输的延迟,提高乘法器的速度,并通过对三种结构的实现效率进行对比得到了验证.
数字信号处理器中阵列乘法器的研究与实现
【摘 要】
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文章讨论了基本的线形阵列加法器和基于水平压缩矩阵的并行阵列加法器,在此基础上提出了一种改进的阵列乘法器结构,通过生成多位的部分积,大大减少进位传输的延迟,提高乘法器
【机 构】
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中国民航飞行学院,西北工业大学计算机学院
【出 处】
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微电子学与计算机
【发表日期】
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2005年10期
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