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本文提出一种能够明显减小正码速调整等候抖动的新方法——分离塞入比法。采用此方法的超大规模专用集成电路已在日本制成。本文简介这种方法提出的背景、原理、实验结果及应用特点。
一种减小正码速调整等候抖动的新方法
【摘 要】
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本文提出一种能够明显减小正码速调整等候抖动的新方法——分离塞入比法。采用此方法的超大规模专用集成电路已在日本制成。本文简介这种方法提出的背景、原理、实验结果及应
【机 构】
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清华大学,清华大学
【出 处】
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通信学报
【发表日期】
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1992年1期
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