【摘 要】
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在此完成了H.264/AVC解码器中高效低功耗的去块效应滤波器设计。该设计采用5阶流水线技术,配合混合边界滤波顺序与打乱次序的存储数据更新机制,解决了数据与结构冒险问题,因
【机 构】
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北京工业大学集成电路与系统集成实验室
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在此完成了H.264/AVC解码器中高效低功耗的去块效应滤波器设计。该设计采用5阶流水线技术,配合混合边界滤波顺序与打乱次序的存储数据更新机制,解决了数据与结构冒险问题,因此获得了正常流水线操作中的0延迟,使得基于流水线的设计架构得到最大程度的实现,同时提高了系统吞吐量并降低了功耗。该设计在FPGA芯片上验证的工作频率上限大约为200 MHz,吞吐量为滤波单个宏块需要198个时钟周期。使用0.18μm CMOS工艺,Synopsys Co.的DC工具对滤波器模块进行综合,结果为时序收敛,功耗约为2μW。仿
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