【摘 要】
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FPGA因为相较于传统的ASIC拥有许多优势,在该领域的重要性也在不断提高。为了保证基于LMS自适应数字滤波器在硬件上的高效实现,使用无乘法结构的实现方案能够获得更好的效果
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FPGA因为相较于传统的ASIC拥有许多优势,在该领域的重要性也在不断提高。为了保证基于LMS自适应数字滤波器在硬件上的高效实现,使用无乘法结构的实现方案能够获得更好的效果。FPGA实现自适应数字滤波器的复杂性取决于乘法累加(MAC)的操作数量,而使用并行分布式算法通过使用查找表(LUT)替代乘法累加运算,能够显著降低硬件实现的复杂性,并且能减少逻辑资源的利用率,同时利用FPGA并行处理的优势,可以提高运行速度。所提出的方法通过软件仿真证明其有效性和优越性。
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