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介绍了用CPLD＋HDL的EDA技术作为开发手段，实现对16通道脉冲信号计数的脉冲计数器的设计。该方法具有设计周期短，内部电路模块可移植的特点，解决了以往数字电路小规模多器件组合的设计瓶颈，经实际电路测试，该系统性能可靠。
基于CPLD的脉冲计数器设计
【摘 要】
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介绍了用CPLD＋HDL的EDA技术作为开发手段，实现对16通道脉冲信号计数的脉冲计数器的设计。该方法具有设计周期短，内部电路模块可移植的特点，解决了以往数字电路小规模多器件组合的
【机 构】
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山西大学计算机与信息技术学院
【出 处】
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山西电子技术
【发表日期】
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2007年5期
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