AES加密算法的高速低功耗ASIC设计

来源 :微计算机信息 | 被引量 : 0次 | 上传用户：zuoshuqiong

【摘要】

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本文提出了一个AES加密算法的高速低功耗ASIC设计方案,使用Synopsvs设计流程和VeriSilicon 0.18μm CMOS工艺,实现了最高工作频率410MHz,数据吞吐率5.23Gbps,功耗为58 mW.采

【作者】

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董策杨志家

【机构】

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110016,110016

【出处】

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微计算机信息

【发表日期】

：

2005年09X期

【关键词】

：

AES ASIC T盒功耗管理时钟门控 AESASIC T-Box power management clock gating

【基金项目】

：

中国科学院科研项目

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本文提出了一个AES加密算法的高速低功耗ASIC设计方案,使用Synopsvs设计流程和VeriSilicon 0.18μm CMOS工艺,实现了最高工作频率410MHz,数据吞吐率5.23Gbps,功耗为58 mW.采用改进算法(T盒算法),将轮变换操作中的不同步骤合并为一组表的查询,有效降低了关键时序路径的传输延迟,并通过动态功耗管理和门控时钟等低功耗设计方法有效地降低了功耗.

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