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M步“加-比-选”相关论文

高速Viterbi译码器中加-比-选单元的设计与实现

限制高速Viterbi译码实现的"瓶颈"为具有非线性反馈特征的"加-比-选"单元.文献[3]在分析"加-比-选"运算代数结构的基础上提出了M步......

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VITERBI译码一步“加-比-选” M步“加-比-选” 流水线 FPGA Viterbi decoding 1-step add-compare-selec

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