快速触发器的设计与优化

来源 :第十八届计算机工程与工艺年会暨第四届微处理器技术论坛 | 被引量 : 0次 | 上传用户:zlzlzl567
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针对现在设计中采用由负latch和正latch组成上升沿触发的触发器普遍存在速度慢、功耗大等问题,本文借鉴触发器标准单元的设计结构,提出了一种运算速度快、功耗小的快速脉冲触发器电路结构.在40nm工艺环境下,以带二选一的SDFQD2BWP12T为例,完成了电路的设计及优化.实验结果表明,在相同的约束条件下,快速脉冲触发器相对于标准单元SDFQD2BWP12T来说在时序上平均减少了58.82%,功耗上减少了11.47%.所以该快速触发器具有更高的性能.
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