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时钟恢复(CDR)电路被广泛的应用于数据传输的各个方面。针对数字基带传输系统,对未知频率的码元信号,本文提出一种在宽频范围内自适应的时钟恢复算法,能够从频率为到的非归零码中恢复出时钟信号。本算法是基于数字逻辑的,特别适合在可编程逻辑器件上实现。最后用Verilogl编程并下载到FPGA,给出了仿真波形和该系统的性能参数。