【摘 要】
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该文内容即为研究一种混合信号电路的可测试性设计方法.该论文基于两个JTAG边界扫描测试体系标准,并将数字电路JTAG体系标准IEE1149.1和模拟电路的JTAG体系标准IEEEII49.4实
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该文内容即为研究一种混合信号电路的可测试性设计方法.该论文基于两个JTAG边界扫描测试体系标准,并将数字电路JTAG体系标准IEE1149.1和模拟电路的JTAG体系标准IEEEII49.4实现为具体电路,并设计一种存储器的并行内建自测试BIST电路.对于IEEE1149.1标准,该文在前人工作的基础上,对现有的电路进行改进,使其可以由原来支持四条指令扩展为支持全部的7条公开测试指令;对于IEEE1149.4标准,该文给出了一种支持该标准的可测试性电路结构.该文还提出了一种基于TRSMarch算法的存储器BIST电路,这种电路可以同时对不同字宽、不同容量的存储器进行测试.
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