【摘 要】
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该文研究了模块化雷达信号处理器的结构特点,并针对一个典型的基于多SHARC的雷 达信号处理器,提出并实现了一套适于该系统结构的、并行的、点数可变的基2复数FFT算法.并依据
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该文研究了模块化雷达信号处理器的结构特点,并针对一个典型的基于多SHARC的雷 达信号处理器,提出并实现了一套适于该系统结构的、并行的、点数可变的基2复数FFT算法.并依据该算法,对处理器的运行周期、帧延迟和并行效率进行了测试.针对算法实现当中遇到的问题,该文对该处理器的结构提出了改进建议.最后,该文还介绍了一种高速和高精度的双路A/D转换模块的实现方案,并对硬件的动态性能进行了测试.该模块的采样频率为40MHz,当输入正弦信号频率为8MHz时,可测得其I、Q两路的动态有效位数均可达到9.2位.
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