基于FPGA的信道编译码技术的研究

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随着信息时代的迅速发展,对信息传递的可靠性要求越来越高,信道编码技术也逐渐成为热门研究领域。现时的信道编码技术中,有传统的卷积码、RS码、Turbo码,也有最新研究出来的低密度奇偶校验码(LDPC)码、polar码等。由于LDPC码的纠错性能优异,并且接近香农(Shannon)限,使得LDPC码在诸多通信标准中被作为信道编码方案应用。LDPC码是一种特殊的线性分组纠错码,利用检验矩阵进行编译码,并且校验矩阵只有0、1元素,具有稀疏性。相对于其他的编码方式,LDPC码编码方法易于分析和研究,硬件的实现也能达到较高的吞吐量,并且具有更低的错误平层。LDPC码具有较大的研究价值和意义。本文对信道编码研究现状做简要的分析。描述了信道编码基本原理,阐述WLAN的关键技术,并介绍了基于IEEE802.11ac标准的物理层帧结构。介绍了不同信道编码方法的描述方法、编码过程、译码过程。通过校验矩阵的不同构造方式,对现有主流的LDPC码的几种不同编码方式进行分析介绍、对置信传播译码算法进行详细的公式推导。基于IEEE.802.11ac标准下,分析不同译码方法在MATLAB仿真下的性能差异,并对BP译码算法中不同迭代次数下译码性能进行对比。最后提出利用基于近似下三角的编码方法完成编码器的设计,利用校验矩阵结构的特殊性,对校验矩阵进行初等变换,通过矩阵计算完成编码过程。采用改进的最小和BP译码算法实现译码器的方案,在性能仿真结果中,改进的最小和BP译码算法在性能上不如LLR BP,但便于硬件的设计与实现,设计译码器的核心模块中,对校验节点更新单元和变量节点更新单元采用串行译码方式,降低译码复杂度,节省FPGA的逻辑资源。通过对仿真结果的分析,验证了方案在FPGA上实现的可行性。
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