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以分频系数为半整数分频器的设计为例,介绍了在MAX+PLUSⅡ开发平台下,利用VHDL硬件描述语言和原理图输入方式,设计数字逻辑电路的过程.
分频系数为半整数分频器的CPLD设计
【摘 要】
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以分频系数为半整数分频器的设计为例,介绍了在MAX+PLUSⅡ开发平台下,利用VHDL硬件描述语言和原理图输入方式,设计数字逻辑电路的过程.
【机 构】
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海军航空工程学院青岛分院,空军工程大学工程学院
【出 处】
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现代电子技术
【发表日期】
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2001年1期
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