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异步DSP核心设计:更低功耗,更高性能
异步DSP核心设计:更低功耗,更高性能
来源 :中国集成电路 | 被引量 : 0次 | 上传用户:a63685296
【摘 要】
:
目前,处理器性能的主要衡量指标是时钟频率。绝大多数的集成电路(Ic)设计都基于同步架构,而同步架构都采用全球一致的时钟。这种架构非常普及,许多人认为它也是数字电路设计的唯一
【作 者】
:
James hwad
【机 构】
:
OctasicInc.
【出 处】
:
中国集成电路
【发表日期】
:
2008年10期
【关键词】
:
数字电路设计
异步设计
性能
低功耗
DSP
时钟频率
集成电路
处理器
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目前,处理器性能的主要衡量指标是时钟频率。绝大多数的集成电路(Ic)设计都基于同步架构,而同步架构都采用全球一致的时钟。这种架构非常普及,许多人认为它也是数字电路设计的唯一途径。然而,有一种截然不同的设计技术即将走上前台:异步设计。
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