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设计了一种基于FPGA的高精度TDC,通过延迟链插值和多沿采样等方法,达到与全定制专用集成电路相同的时间精度,实测结果好于9 ps。采用多路选择器阵列和加法器构造的编码器将转换死时间降低到1个时钟周期。设计还使用了自校准的机制,增加了可移植性,可广泛应用于粒子飞行时间探测、核医学影像等领域。
一种基于FPGA的高精度单周期TDC设计
【摘 要】
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设计了一种基于FPGA的高精度TDC,通过延迟链插值和多沿采样等方法,达到与全定制专用集成电路相同的时间精度,实测结果好于9 ps。采用多路选择器阵列和加法器构造的编码器将转
【机 构】
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清华大学工程物理系粒子技术与辐射成像教育部重点实验室
【出 处】
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核电子学与探测技术
【发表日期】
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2011年04期
【基金项目】
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自然科学基金,一种高密度,高计数率,高时间分辨率MRPC探测器读出ASIC的研制(10975089)
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