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研究以太网系统中帧校验序列(FCS)的并行处理方法。根据串行CRC-32编码原理,导出并行CRC-32编码算法,并且给出Verilog HDL语言设计的并行CRC-32软核。使其能够方便、灵活的应用到高速以太网系统设计中。
以太网中8位并行CRC-32软核设计
【摘 要】
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研究以太网系统中帧校验序列(FCS)的并行处理方法。根据串行CRC-32编码原理,导出并行CRC-32编码算法,并且给出Verilog HDL语言设计的并行CRC-32软核。使其能够方便、灵活的应
【机 构】
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西安邮电学院计算机系
【出 处】
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西安邮电学院学报
【发表日期】
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2006年05期
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