12位50 MHz流水线ADC采样保持电路实现

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对采样保持电路进行研究,对增益提高的运算放大器进行2阶系统模拟,得到最佳设计参数;提出一种栅压自举开关电路结构;设计了一个用于12位50 MHz流水线A/D转换器的采样保持电路。采用SMIC 0.35 μm混合CMOS工艺,对整个A/D转换器进行实现。测试结果表明,采样保持电路完全满足设计要求。 The sampling and holding circuit is studied, and the second-order system simulation of the gain-increasing operational amplifier is performed to obtain the optimal design parameters. A gate-voltage bootstrap switch circuit structure is proposed. A 12-bit 50 MHz pipeline A / D conversion Sample and hold circuit. The entire A / D converter is implemented with a SMIC 0.35 μm hybrid CMOS process. The test results show that the sample and hold circuit fully meets the design requirements.
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