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本文提出一种站为边界的流水线仿真调试控制机制.该机制实现了目标数字信号处理器(DSP)的CPU流水线完成调试状态下对流水线的仿真停、仿真运行和单步运行的控制;解决了调试过程中以系统时钟周期为边界的流水线的弊端,利于调试过程中的设置硬件断点、软件断点和单步等操作的运行.
一种具有准确流水线站边界的仿真调试控制机制
【摘 要】
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本文提出一种站为边界的流水线仿真调试控制机制.该机制实现了目标数字信号处理器(DSP)的CPU流水线完成调试状态下对流水线的仿真停、仿真运行和单步运行的控制;解决了调试过程中以系统时钟周期为边界的流水线的弊端,利于调试过程中的设置硬件断点、软件断点和单步等操作的运行.
【机 构】
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国防科技大学计算机学院 长沙 410073
【出 处】
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第十届计算机工程与工艺全国学术年会
【发表日期】
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2006年8期
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