【摘 要】
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基于40nm工艺下YHFT-DX芯片的乘加运算模块(VMAC)，充分利用网格型时钟网络具有长公共路径，时钟偏差小，负载能力强等优点，设计并实现网格型时钟网络拓扑结构，分析内容包括网格
【机 构】
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湖南省长沙市国防科技大学计算机学院 410073
【出 处】
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第十八届计算机工程与工艺年会暨第四届微处理器技术论坛
论文部分内容阅读
基于40nm工艺下YHFT-DX芯片的乘加运算模块(VMAC)，充分利用网格型时钟网络具有长公共路径，时钟偏差小，负载能力强等优点，设计并实现网格型时钟网络拓扑结构，分析内容包括网格结构的组成，驱动单元的选择，布线宽度及间距的确定，并给出时钟偏差分析方法。通过对比发现网格型时钟结构较平衡树型结构在各端角下都具有较小的时钟偏差。
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