基于DDR3 SDRAM的访存调度器设计与实现

来源 :第十七届计算机工程与工艺年会暨第三届微处理器技术论坛 | 被引量 : 0次 | 上传用户:mengshenabc
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  基于优先级的仲裁策略,设计与实现了访存调度器,根据优先级从高到低的顺序对连续的多个请求进行重排序,从而提高存储器的访存效率.使用NC Verilog测试和验证了访存调度RTL级代码的正确性,基于TSMC40nm工艺,用Cadence公司RTL Compiler工具对访存调度器的RTL级代码进行综合,综合结果表明时序、面积、功耗方面都满足设计要求,并且运行频率最高可达2.22 GHz.
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