【摘 要】
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该文研究的RTL综合系统的目标是将用户输入的VHDL语言的RTL描述转化为门级网表.该课题研究的重点是解决将RTL描述转化为门级网表的过程中一系列重要的技术问题,提出并实现相
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该文研究的RTL综合系统的目标是将用户输入的VHDL语言的RTL描述转化为门级网表.该课题研究的重点是解决将RTL描述转化为门级网表的过程中一系列重要的技术问题,提出并实现相应的解决策略与设计方法.该系统由两人分工合作完成,该文负责数据结构的建立、可综合性检查、时序逻辑综合、变量综合及子程序综合,同时合作完成系统的总体设计及测试.首先,为实现PTL综合系统,对整个RTL综合系统进行总体设计及接口设计.其次,为RTL综合系统建立综合所需要的中间数据结构.第三,实现RTL综合系统的关键技术之一的时序逻辑综合,提出具体综合流程与算法.第四,该文首先分析变量与信号的区别,从而总结变量在RTL描述中的作用,最终确定变量赋值语句的综合方法是将变量消除或生成寄存器,并在关联链表的基础上实现了变量赋值语句的综合算法.第五,该文对一次调用的子程序采用了嵌入方式实现,对多次调用的子程序采用例示方式实现,同样也给出了具体的实现算法.在上述研究工作基础上,构造了一个较完善的RTL综合系统,众多测试实例表明该系统工作正确,性能稳定.
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