【摘 要】
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该设计中根据计程测速电路所需的功能,采用Top_down和Bottom_up相结合的层次式设计方法分析、设计了计程测速电路.设计中采用ABEL硬件描述语言和原理图相结合的方法编写源程
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该设计中根据计程测速电路所需的功能,采用Top_down和Bottom_up相结合的层次式设计方法分析、设计了计程测速电路.设计中采用ABEL硬件描述语言和原理图相结合的方法编写源程序.ABEL源程序的编写中,根据电路的特点灵活使用高级方程、真值表、状态图多种描述方式产生源程序.设计中合理地设置仿真、适配控制选项,经过仿真验证了电路的逻辑功能,然后经过适配产生了JEDEC下载文件.最后利用IDCD下载软件把设计下载到三片ispLSI1032E中,在制作出的目标PCB上实现了计程测速电路.设计出的计程测速电路具有记录、计算并显示瞬时速度、最大速度、平均速度、阶段里程、总里程的功能,以及自动开机、定时延迟关机和超速报警等功能.使用HDPLD进行电路设计具有设计周期短,可多次重复编程的特点,使用相当便捷,是科研实验、样机试制、小批量产品的即时实现以及IC设计中试的最佳途径.HDPLD的设计方法已成为ASIC设计的重要方法之一.由于器件的工艺和结构事先确定,对于较特殊的ASIC电路这种方法也不一定能适用.然而,根据电路的特点选用合适的器件类型和进行适当的描述将有助于提高器件的资源利用率和电路的性能.
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