【摘 要】
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H.264是目前最先进的视频编码标准,由ITU-T的视频编码专家组(VCEG)和ISO/IEC的活动图像编码专家组(MPEG)组成的联合视频组(JVT)制定。H.264的编码效率很高,与以往的标准相比,
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H.264是目前最先进的视频编码标准,由ITU-T的视频编码专家组(VCEG)和ISO/IEC的活动图像编码专家组(MPEG)组成的联合视频组(JVT)制定。H.264的编码效率很高,与以往的标准相比,在同样的重建图像质量下,其码率能降低50%左右。在深入研究H.264视频编码标准的基础上,本文完成了H.264解码芯片中片层解码的ASIC设计。片层解码主要包括三部分:NAL单元(NALU)的解码,参考图像列表的生成和解码图像缓冲区(DPB)的设计。本文采用自顶向下的设计方法,首先进行模块的功能划分,确定各模块的输入输出以及模块之间的互连方式,然后分别对每个子模块进行硬件电路设计和仿真分析,最后将所有模块整合在一起做仿真分析和综合验证。所有模块都是用Verilog HDL编写的,已经通过RTL级仿真和综合。设计完成后,使用标准视频序列作为输入,对模块进行了大量的仿真分析,结果表明,设计完全符合H.264的功能要求。
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