【摘 要】
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为提高空间环境下电子设备的可靠性,提升抗辐射加固SOI（Silicon on Insulator）集成电路的设计效率,通过构建完整的建库流程,自主设计开发了基于3.3V-0.35μm-PD（Partly）SOI CMOS（C
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为提高空间环境下电子设备的可靠性,提升抗辐射加固SOI（Silicon on Insulator）集成电路的设计效率,通过构建完整的建库流程,自主设计开发了基于3.3V-0.35μm-PD（Partly）SOI CMOS（ComplementaryMetal-Semiconductor）工艺平台,并面向Synopsys电子设计自动化软件的抗辐射加固标准单元库。标准单元采用H型栅及源漏非对称注入结构,以提高抗辐射性能,最后对该单元库进行了电子设计自动化工具流程验证和测试验证。实验结果表明,检错纠错验证电路功
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