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本文在介绍了经典全数字锁相环(all digital PLL,ADPLL)的基础上,提出了具有捕获锁定未知输入信号频率功能的ADPLL,使用方便,应用广泛.本文详尽的描述了系统的工作原理和关键部件的设计,通过计算机进行了仿真验证,并在可编程逻辑器件(FPGA)中予以实现.
一种改进的全数字锁相环设计
【摘 要】
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本文在介绍了经典全数字锁相环(all digital PLL,ADPLL)的基础上,提出了具有捕获锁定未知输入信号频率功能的ADPLL,使用方便,应用广泛.本文详尽的描述了系统的工作原理和关键
【机 构】
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110016,110016
【出 处】
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微计算机信息
【发表日期】
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2005年09S期
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