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以CPLD器件EPM7128SLC84—6为核心的电器定时开关控制系统设计实现24小时制时钟功能，可同时设置多个电器的定时自动开启和关闭．开关时间从0时0分到23时59分之间任意可调。CPLD部分使用Verilog HDL在QuartusⅡ5．0环境中编写。并给出了主要设计程序。
基于CPLD的电器定时开关控制系统设计
【摘 要】
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以CPLD器件EPM7128SLC84—6为核心的电器定时开关控制系统设计实现24小时制时钟功能，可同时设置多个电器的定时自动开启和关闭．开关时间从0时0分到23时59分之间任意可调。CPLD
【机 构】
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河北大学电子信息工程学院
【出 处】
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国外电子元器件
【发表日期】
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2008年7期
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