【摘 要】
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航天用FPGA设计复杂度越来越高，其表现之一就是设计中存在多个时钟域，当信号从一个时钟域进入另一个时钟域，即不同时钟域之间发生数据交互时，就会带来信号跨时钟域产生的亚稳态问
【机 构】
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中国航天科技集团公司第九研究院第七七一研究所
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航天用FPGA设计复杂度越来越高，其表现之一就是设计中存在多个时钟域，当信号从一个时钟域进入另一个时钟域，即不同时钟域之间发生数据交互时，就会带来信号跨时钟域产生的亚稳态问题（CDC问题）。亚稳态问题虽普遍存在，但依靠传统的验证手段即功能仿真或者时序仿真是很难定位的，提出一种分层次、多模式的跨时钟域验证方法，为跨时钟域问题分析确认提供强有力的参考。
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