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基于FPGA时域有限差分算法的设计与实现

来源 :上海电力学院学报 | 被引量 : 0次 | 上传用户：kkhaizi

【摘 要】

：

以时域有限差分法的二维形式为例，用Verilog HDL语言加以实现．采用32位单精度浮点数进行加减法和乘法运算，以保证计算的精度．通过modelsim软件仿真，以AlteraFPGA的硬件实现来确保

【作 者】

：

赵倩 

【机 构】

：

上海电力学院电子与信息工程学院

【出 处】

：

上海电力学院学报

【发表日期】

：

2017年1期

【关键词】

：

时域有限差分法 可编程逻辑器件 VERILOG硬件描述语言 二维TM波 finite difference time domain algorithm  FPG 

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以时域有限差分法的二维形式为例，用Verilog HDL语言加以实现．采用32位单精度浮点数进行加减法和乘法运算，以保证计算的精度．通过modelsim软件仿真，以AlteraFPGA的硬件实现来确保设计的正确性．实验结果显示，基于FPGA的时域有限差分法硬件实现方法对提高速度效果明显，是提高算法性能的有效途径．

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