【摘 要】
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基于0.18μm CMOS工艺,设计了一种锁定频率范围在1.8～2.4 GHz的电荷泵锁相环.采用高性能的鉴频鉴相器、电荷泵以及三阶Σ-△调制器,减小了输出时钟的参考杂散.在Σ-△调制器中引入线性反馈移位寄存器(LFSR),生成伪随机序列,进一步降低了小数杂散.仿真结果表明,在0.3～1.5 V输出电压范围内,锁相环的电流失配比仅为0.1％,小数杂散为-50 dBc@1 MHz.
【机 构】
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郑州铁路职业技术学院,郑州450052
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基于0.18μm CMOS工艺,设计了一种锁定频率范围在1.8～2.4 GHz的电荷泵锁相环.采用高性能的鉴频鉴相器、电荷泵以及三阶Σ-△调制器,减小了输出时钟的参考杂散.在Σ-△调制器中引入线性反馈移位寄存器(LFSR),生成伪随机序列,进一步降低了小数杂散.仿真结果表明,在0.3～1.5 V输出电压范围内,锁相环的电流失配比仅为0.1％,小数杂散为-50 dBc@1 MHz.
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