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本文提出了一种改进的两步式ADC拓扑结构。当ADC的分辨率为n位时，这种结构只需要（2^n/2＋1-2）或（2^n-1/2）个比较器。与传统的两步式ADC相比，其比较器数目的大大减少，使得ADC电路的功耗和芯片面积随之显著降低。此结构适用于高速便携式VLSI系统。
改进的低功耗两步式ADC结构
【摘 要】
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本文提出了一种改进的两步式ADC拓扑结构。当ADC的分辨率为n位时，这种结构只需要（2^n/2＋1-2）或（2^n-1/2）个比较器。与传统的两步式ADC相比，其比较器数目的大大减少，使得ADC电路的功耗
【机 构】
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成都电子科技大学,西南科技大学,至今就读于电子科技大学微电子与固体电子学院
【出 处】
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微计算机信息
【发表日期】
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2006年05Z期
【基金项目】
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此论文由国家自然科学基金资助项目资助基金编号：No.600172004
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