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提出了一种基于IEEE-754的32 bit、64 bit浮点数格式，二叉树数据流（binary tree data flow ）的矩阵向量乘法器。其在FPGA上流水线和高度并行化的高效执行。以Altera公司的EP2C70为实现设备，研究了设计的硬件规模，时钟速度，和峰值GFLOPS能力。
浮点矩阵向量乘法的FPGA设计与优化
【摘 要】
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提出了一种基于IEEE-754的32 bit、64 bit浮点数格式，二叉树数据流（binary tree data flow ）的矩阵向量乘法器。其在FPGA上流水线和高度并行化的高效执行。以Altera公司的EP2C70
【机 构】
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天津工业大学计算机学院
【出 处】
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微电子学与计算机
【发表日期】
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2013年11期
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