一种快速除法算法的FPGA实现

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介绍了一种新的除法算法,该算法是利用Taylor公式,用两次乘法操作和一张较小的查找表实现。整个算法采用verilog语言描述,设计灵活、实现简单。仿真效果表明该算法具备较高的精度与较快的运算速度。 A new division algorithm is introduced, which uses the Taylor formula to perform two multiplication operations and a smaller lookup table. The entire algorithm using verilog language description, design flexibility, easy to implement. Simulation results show that the algorithm has higher accuracy and faster computing speed.
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