一种用于高可靠性同步器电路的D触发器设计

来源 :电子器件 | 被引量 : 0次 | 上传用户：zhanglq

【摘要】

：

随着VLSI设计的发展,设计师时常需要面临不同时钟域之间信号传输和异步复位/置位等情况,在这类情况下,电路就有可能出现亚稳态.为此首先介绍了亚稳态的特性,以及处理亚稳态的

【作者】

：

宋红东胡晨杨军

【机构】

：

东南大学

【出处】

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电子器件

【发表日期】

：

2003年1期

【关键词】

：

亚稳态时序冲突触发器 Metastability timing violation flipflop

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随着VLSI设计的发展,设计师时常需要面临不同时钟域之间信号传输和异步复位/置位等情况,在这类情况下,电路就有可能出现亚稳态.为此首先介绍了亚稳态的特性,以及处理亚稳态的一种解决方案,D触发器在亚稳态下的特性.提出了一种减少亚稳态出现可能性的D触发器单元的设计方案,并使用H-SPICE进行了仿真.

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