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基于数字可驯钟中伪码产生器的FPGA设计
基于数字可驯钟中伪码产生器的FPGA设计
来源 :电子测量与仪器学报 | 被引量 : 0次 | 上传用户:xtipdx
【摘 要】
:
针利用伪随机码良好的自相关特性,将两路伪码进行相关得到相关值,通过对相关值的计算得到高分辨率的相位差信息.因此,伪随机码可以用于时延的高精度测量.本文在数字可驯钟系
【作 者】
:
郭伟
华宇
向渝
董道鹏
【机 构】
:
中国科学院国家授时中心,中国科学院研究生院
【出 处】
:
电子测量与仪器学报
【发表日期】
:
2004年期
【关键词】
:
伪随机码
鉴相器
数字可驯钟戳
FPGA
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针利用伪随机码良好的自相关特性,将两路伪码进行相关得到相关值,通过对相关值的计算得到高分辨率的相位差信息.因此,伪随机码可以用于时延的高精度测量.本文在数字可驯钟系统的鉴相器设计中,利用伪码的自相关特性来测量时延,得到了较好的测量结果,并给出了伪码产生器的FPGA实现.
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