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应用FPGA设计数字电路时,芯片的运行速度优化与资源利用优化常常是相互矛盾的。以Viterbi译码器中加比选单元（ACS）的设计为例,对采用传统方法和流水线技术方法的设计进行对比,显示采用流水线技术的设计方法在占用较小系统资源情况下可以获得更高的系统运行速度,更适用于FPGA的数字电路设计。
流水线技术在FPGA设计中的运用
【摘 要】
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应用FPGA设计数字电路时,芯片的运行速度优化与资源利用优化常常是相互矛盾的。以Viterbi译码器中加比选单元（ACS）的设计为例,对采用传统方法和流水线技术方法的设计进行对比,
【机 构】
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武警石家庄士官学校信息与通信工程研究所,武警石家庄士官学校通信三系
【出 处】
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计算机时代
【发表日期】
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2016年2期
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