【摘 要】
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设计了一种高性能、低功耗的Radix-8时序复数除法器.该复数除法器采用了逐位递归算法和操作数预变换技术,并在传统结构的基础上,选用冗余形式保留预校正变量,节省了超长进位
【机 构】
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西安交通大学电子与信息工程学院,加州大学洛杉矶分校计算机科学系
【基金项目】
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国家基础研究发展规划资助项目（2007CB311005）,国家高技术研究发展计划资助项目（2009AA01Z307,2006AA01Z192,2006AA01Z318）,国家留学基金委资助项目（2008628039）.
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设计了一种高性能、低功耗的Radix-8时序复数除法器.该复数除法器采用了逐位递归算法和操作数预变换技术,并在传统结构的基础上,选用冗余形式保留预校正变量,节省了超长进位加法器的使用,缩短了关键路径的延时.设计还通过实部和虚部商位的合并以及基于6输入查找表结构的硬件优化,提高了乘加逻辑单元的资源利用率.Stratix-II型现场可编程逻辑器件仿真验证表明,与使用超长进位加法器的传统结构相比,所设计的复数除法器的速度提高了44%,硬件资源减少了31%.
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