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针对B码时统解码的精度及硬件使用效率等问题，结合B码原理，从应用角度出发，提出一种新型的B码的解码方案。利用微控制器STM32辅助可编程逻辑器件（FPGA），进行全局解码设计。测试表明，DC码的秒头精度误差控制在ns级，且DC码和AC码解码所提取出的时间信息都非常准确。
STM32与FPGA的B码时统解码设计
【摘 要】
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针对B码时统解码的精度及硬件使用效率等问题，结合B码原理，从应用角度出发，提出一种新型的B码的解码方案。利用微控制器STM32辅助可编程逻辑器件（FPGA），进行全局解码设计。测试表明
【机 构】
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苏州科技学院,安徽理工大学
【出 处】
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单片机与嵌入式系统应用
【发表日期】
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2013年9期
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