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介绍了一种平均幅度和加权过零率的VAD算法,并对该算法进行了硬件实现。对其中主要的模块,在硬件实现方法上进行了优化,取得了较好效果,使其在保证实时性要求的同时节省了资源,为进一步向低成本器件上移植或系统中作为IP模块应用提供了可能性。
基于平均幅度和加权过零率的VAD算法及其FPGA实现
【摘 要】
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介绍了一种平均幅度和加权过零率的VAD算法,并对该算法进行了硬件实现。对其中主要的模块,在硬件实现方法上进行了优化,取得了较好效果,使其在保证实时性要求的同时节省了资
【机 构】
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信息工程大学国家数字交换系统工程技术研究中心
【出 处】
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信息工程大学学报
【发表日期】
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2010年6期
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