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讨论了基于滑窗MAX-LOG-MAP算法的Turbo码译码器的FPGA实现方案。采用基于流水线和多时钟的设计,提高了译码速度,同时在对算法流程分析基础上,通过优化设计,减少了译码所需的存储量。整个设计用VHDL语言描述,并在Altera公司的Cyclone系列上得到了实现。
基于FPGA的Turbo码译码器设计与实现
【摘 要】
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讨论了基于滑窗MAX-LOG-MAP算法的Turbo码译码器的FPGA实现方案。采用基于流水线和多时钟的设计,提高了译码速度,同时在对算法流程分析基础上,通过优化设计,减少了译码所需的
【机 构】
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西安电子科技大学综合业务网国家重点实验室,西安电子科技大学综合业务网国家重点实验室
【出 处】
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北京电子科技学院学报
【发表日期】
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2004年04期
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