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提出了一种具体的C波段小步进频率合成器的设计方案。该方案是基于锁相环频率合成（PLL）和直接数字频率合成（DDS）相结合的结构，利用DDS激励PLL产生所需信号。设计的信号频率范围为5．02-5．38GHz，频率步进为1kHz。重点阐述了系统的硬件实现，包括系统设计方案、主要电路模块设计以及系统测试结果等，并针对实际调试过程中常见的问题给出一些改进的方法。最后的测试结果表明了该频率合成器具有频谱纯、相噪低、杂散抑制能力强等特点，可以满足实际系统需要。