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移位可加性相关论文
VLSI测试中移相伪随机序列的设计
为了用较少的硬件和测试时间开销获得对被测电路较高的故障覆盖,提出了一种数字集成电路测试中多扫描链的配置方法.该方法基于最大......
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VLSI测试
移相伪随机序列
线性反馈移位寄存器
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M序列
移位可加性
伪随机测试
数字集成电路
linear feedback shift regist
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