【摘 要】
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为了控制高速实时信息流在网络中的延迟,保证网络的服务质量,贾伟嘉、王汉兴等在(σ,ρ)调节器的基础上构建了(σ,ρ,λ)调节器.他们假设进入网络的信息包的最大长度L=0、信
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为了控制高速实时信息流在网络中的延迟,保证网络的服务质量,贾伟嘉、王汉兴等在(σ,ρ)调节器的基础上构建了(σ,ρ,λ)调节器.他们假设进入网络的信息包的最大长度L=0、信息流的速率函数R(t)∈[0,C],其中C为链接的传输速率.并研究了用(σ,ρ,λ)调节器调节信息流时,任一比特在网络元件中的延迟.考虑到实际网络中,信息包经常是一个个间断到达的,所以该文在假设进入网络的信息流的速率函数R(t)∈{0,C}、信息包的最大长度L>0的条件下,研究了用(σ,ρ,λ)调节器对信息流进行调节时,任一比特在单个(σ,ρ,λ)调节器、单个多路转换器(包括一般转换器和LFCFS转换器)中的延迟,并研究了信息流在交换节点是一般转换器和LFCFS转换器的多级网络中的延迟,同时对这些延迟与Cruz[1]的相应结果进行了比较.
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